基于可编程逻辑器件和VHDL语言实现算术逻辑单元的设计
1、引言 随着可编程逻辑器件的发展，FPGA的应用已经越来越广泛，且用可编程逻辑器件代替传统的普通集成电路已成为一种发展的趋势。可编程逻辑器件FPGA以其高集成度、高速度、开发周期短、稳定性好而受到了人们的青睐，并得到了广泛的应用。由于算术逻辑单元（ALU）在运算中对系统性能要求很高，而采用中小规模的集成电路设计的系统既庞大又存在稳定性的问题。因此，用可编程逻辑器件FPGA来实现算术逻辑单元是一个
vhdl
现代电子技术 . 2021-01-04 1 1030
如何快速在Verilog和VHDL之间互转
Verilog语言和VHDL语言是两种不同的硬件描述语言，但并非所有人都同时精通两种语言，所以在某些时候，需要把Verilog代码转换为VHDL代码。本文以通用的XHDL工具为例对Verilog转换到VHDL过程中存在的问题进行了总结，欢迎批评指正。 当我们刚开始学习FPGA时，一定会遇到一个问题： 学习Verilog还是VHDL？ 等我们学习FPGA到一定程度参加面试时，面试者也会问你一个问题：
Verilog
网络交换FPGA . 2020-11-10 1570
深度解析ESIstream架构的具体实现方案
概述 当使用现代宽带数据转换器时，管理产生的高速串行数据流是一个巨大的挑战。ESIstream是一个开源的串行数据接口协议，成本极低，支持多种FPGA架构的简单硬件实现，并占用最小的资源。简单来说，它是JEDEC的JESD204B子集1和2标准的开源替代方案。另外，ESIstream可为用户带来很多好处，这里将讨论其中的一些，包括低复杂度、低链接延迟和实现确定性延迟的简单方案。 本文将仅阐述ESI
pcb
EEWORLD . 2020-11-04 1 1205
基于VHDL文本的时序逻辑电路设计
一、实验目的 熟悉QuartusⅡ的VHDL文本设计过程，学习简单时序逻辑电路的设计、仿真和测试方法。 二、实验 1. 基本命题 用VHDL文本设计触发器，触发器的类型可任选一种。给出程序设计、仿真分析、硬件测试及详细实验过程。 ① 实验原理 由数电知识可知，D触发器由输入的时钟信号（CLK）、数据输入口（D）和数据输出（Q）构成。本程序通过进程监视CLK和D\，当CLK为上升沿的时候，将D赋值给
时钟信号
博客园 . 2020-08-21 1075
采用复杂控制逻辑器件和VHDL语言实现曼彻斯特编解码器的设计
引言 虽然计算机通信的方法和手段多种多样，但都必须依靠数据通信技术。数据通信就是将数据信号加到数据传输信道上进行传输，并在接收点将原始发送的数据正确地恢复过来。由于计算机产生的一般都是数字信号，因此计算机之间的通信实际上都属于数据通信。曼彻斯特码编解码器是1553B总线接口中不可缺少的重要组成部分。曼彻斯特码编解码器设计的好坏直接影响总线接口的性能。在数控测井系统和无线监控等领域，曼彻斯特码编解码
vhdl
电子元器件应用 . 2020-08-03 2065
采用VHDL语言在CPLD内部编程实现Flash读取控制设计
1、概述 本设计已实用于国家863计划“可扩展到T比特的高性能IPv4/v6路由器基础平台及实验系统”项目中。其主要功能是对主控部分的FPGA读取Flash进行控制。 在本项目中，主控部分的FPGA在重启时需要从Flash中下载初始化程序。当下载完成后，FPGA仍会根据需要从Flash相应地址读取数据。这就要求在FPGA和Flash之间有一块控制逻辑来控制对Flash的读取。本设计就是完成的对这块
vhdl
微计算机信息 . 2020-07-15 1420
简述BSDL边界扫描语言，BSDL边界扫描语言的应用
BSDL边界扫描语言的边界扫描是一个完善的测试技术。 边界扫描在自当联合测试行动组（JTAG）90年代初发明了一种解决方案来测试使用了许多新的印刷电路，正在开发和制造的地方几乎没有或根本没有测试探针板的物理访问。 一旦边界扫描成立后，下一步是制定一个标准的芯片供应商的模型边界扫描设备，工具供应商开发自动化工具，以及为最终用户创建的边界扫描测试的建模语言。 因此，边界扫描描述语言（BSDL）已建
数字电子
网络整理 . 2017-04-19 1140
基于VHDL的专用串行通信芯片
目前，许多厂商都提供通用的串行通信芯片，其传输方式分为同步方式和异步方式。其中，异步芯片大多与INTEL的8250芯片兼容；而同步方式，由于一般涉及到所支持的传输协议（BSC、HDLC、SDLC等），所以当用户要求应用特定的同步传输协议时，往往需要设计专用的SRT（同步收发器）。以前，大多采用通用的逻辑元器件进行设计，这导致了设计和调试过程冗长、系统稳定性不高，非常不便。如今，随着以FPGA和
通信芯片
维库电子 . 2012-12-05 1145
- 1