FPGA的设计中的时钟使能电路
时钟使能电路是同步设计的重要基本电路，在很多设计中，虽然内部不同模块的处理速度不同，但是由于这些时钟是同源的，可以将它们转化为单一的时钟电路处理。在FPGA的设计中，分频时钟和源时钟的skew不容易控制，难以保证分频时钟和源时钟同相。故此推荐采用使用时钟使能的方法，通过使用时钟使能可以避免时钟“满天飞”的情况，进而避免了不必要的亚稳态发生，在降低设计复杂度的同时也提高了设计的可靠性。 我们可以利用
fpga
博客园 . 2020-11-10 1540
反向器的输出连接到输入时实验分析
反向器是一个简单的器件，用一个继电器就可以实现。当我们把反向器的输出连接到输入时，会发生什么呢？ 当输入为0时，输出为1；输出连接到输入上，此时输入又变成1，输出值变成0；如此反复。需要特别指出的是，反向器实际上是一个继电器，而继电器从一个状态转换到另一个状态是需要时间的。所以，即使输入和输出是相等的，输出也会很快地改变，成为输入的倒置（当然，随即输出也就改变了输入，如此反复）。 这种电路称为振荡
继电器
博客园 . 2020-10-19 1200
采用米利型的状态机电路设计
1.0 序列检测器电路设计 设计一个序列检测器电路，功能是：检测出串行输入数据Sin中的4位二进制序列0101（自左至右输入），当检测到该序列时，输出Out=1；没有检测到该序列时，输出Out=0（注意考虑序列重叠的可能性，如010101，相当于出现两个0101序列）。 经过分析，首先可以确定采用米利型状态机设计该电路。因为该电路在连续收到信号0101时，输出为1，其他情况下输出为0，所以采用米利
逻辑电路
博客园 . 2020-09-08 1605
高效能的红外接收器电路图设计分析
由455KHZ的晶振CRY，反相器74HC04及电阻、电容构成的振荡器产生455KHZ的方波信号。经脉冲分频器74LS92，六分频成为75.83KHZ的脉冲信号。 再经过D触发器构成的2分频/整形电路变成38KHZ的方波信号。由单片机的异步串行口TX输出的串行数据信号，送到与非门74HC00的输入端。 与非门的另一输入端接38KHZ的载波信号。与非门的输出信号用来控制三极管的开通或关断
单片机
博客园 . 2020-08-24 1345
基于VHDL文本的时序逻辑电路设计
一、实验目的 熟悉QuartusⅡ的VHDL文本设计过程，学习简单时序逻辑电路的设计、仿真和测试方法。 二、实验 1. 基本命题 用VHDL文本设计触发器，触发器的类型可任选一种。给出程序设计、仿真分析、硬件测试及详细实验过程。 ① 实验原理 由数电知识可知，D触发器由输入的时钟信号（CLK）、数据输入口（D）和数据输出（Q）构成。本程序通过进程监视CLK和D\，当CLK为上升沿的时候，将D赋值给
时钟信号
博客园 . 2020-08-21 1160
基于D触发器实现时钟电路同步设计
时钟使能电路是同步设计的重要基本电路，在很多设计中，虽然内部不同模块的处理速度不同，但是由于这些时钟是同源的，可以将它们转化为单一的时钟电路处理。在FPGA的设计中，分频时钟和源时钟的skew不容易控制，难以保证分频时钟和源时钟同相。故此推荐采用使用时钟使能的方法，通过使用时钟使能可以避免时钟“满天飞”的情况，进而避免了不必要的亚稳态发生，在降低设计复杂度的同时也提高了设计的可靠性。 我们可以利用
时钟电路
博客园 . 2020-08-06 955
逻辑电路之D型触发器电路设计
R-S触发器 再来看一个电路：由两个或非门构成，约定左侧的或非门称L（left），或侧的或非门称R（right） 图（1） 初始状态，灯泡不亮，红线处有电压 图（2）好理解一点，L输入都是0，其输出为1，红线标明;R由于有一端输入1，所以其输出是0，结果是灯泡不亮; 这是初始状态 图（2） 接通开关A后，电路导通，灯泡点亮 由于接通了开关A，导致L有一端输入1，故其输出0; 这时R两端输入均为0，
R-S触发器
博客园 . 2020-08-04 1670
同步复位电路和异步复位电路区别分析
复位电路博大精深，并不是三言两语就能说清楚的，因此这里也是聊聊复位电路的基础，更深的研究需要在实际的项目中才能深有体会。本文的主要内容有： ·复位电路概述 ·同步复位电路 ·异步复位电路 ·复位策略——复位网络 1.复位电路概述 复位信号在数字电路里面的重要性仅次于时钟信号。对电路的复位往往是指对触发器的复位，也就是说电路的复位中的这个“电路”，往往是指触发器，这是需要注意的。有的电路需要复位信号
fpga
博客园 . 2020-06-26 1510
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